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2–26 Reference Manual Altera Corporation

Stratix II GX PCI Express Development Board August 2006

Standard Communication Ports

using internal termination resistors in the Stratix II GX device receiver

pins. Table 2–19 lists the PCIe edge connector pin-out and corresponding

Stratix II GX device pin number..

Table 2–19. PCIe Edge Connector Pin-Out

Schematic Signal Name Stratix II GX Pin Number

pcie_led_x1 AU11

pcie_led_x4 AG16

pcie_led_x8 AM13

pcie_perstn AL16

pcie_refclk_n AB8

pcie_refclk_p AB7

pcie_rx_n[0] AG2

pcie_rx_n[1] AE2

pcie_rx_n[2] AJ2

pcie_rx_n[3] AL2

pcie_rx_n[4] W2

pcie_rx_n[5] U2

pcie_rx_n[6] AA2

pcie_rx_n[7] AC2

pcie_rx_p[0] AG1

pcie_rx_p[1] AE1

pcie_rx_p[2] AJ1

pcie_rx_p[3] AL1

pcie_rx_p[4] W1

pcie_rx_p[5] U1

pcie_rx_p[6] AA1

pcie_rx_p[7] AC1

pcie_smbclk AK18

pcie_smbdat AH20

pcie_tx_n[0] AG5

pcie_tx_n[1] AE5

pcie_tx_n[2] AJ5

pcie_tx_n[3] AL5

pcie_tx_n[4] W5

pcie_tx_n[5] U5

pcie_tx_n[6] AA5

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